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嵌入式OS-Linux

Linux應(yīng)用開發(fā)班
嵌入式Linux系統(tǒng)開發(fā)班

嵌入式Linux驅(qū)動開發(fā)班
Linux網(wǎng)絡(luò)工程及系統(tǒng)管理
Linux驅(qū)動、系統(tǒng)、應(yīng)用全能班

嵌入式CPU--ARM

ARM開發(fā)培訓(xùn)班

CortexM3+uC/OS培訓(xùn)班

嵌入式OS--WinCE

WinCE應(yīng)用開發(fā)培訓(xùn)班

WinCE系統(tǒng)定制與驅(qū)動班

單片機(jī)培訓(xùn)

單片機(jī)系統(tǒng)開發(fā)初級和中級班

單片機(jī)系統(tǒng)開發(fā)高級班

嵌入式硬件設(shè)計(jì)

高速嵌入式系統(tǒng)硬件設(shè)計(jì)班

Allegro Cadence PCB設(shè)計(jì)初級和中級班

Allegro Cadence PCB設(shè)計(jì)高級班

Power Pcb(PADS)設(shè)計(jì)培訓(xùn)班

Protel培訓(xùn)班

高效開關(guān)電源設(shè)計(jì)與提高班

電路設(shè)計(jì)培訓(xùn)

EMC設(shè)計(jì)高級培訓(xùn)班

PCB Layout培訓(xùn)-線路板設(shè)計(jì)全能班

Altium Designer Layout高速硬件設(shè)計(jì)

Mentor EE 高速電路板設(shè)計(jì)與仿真

Mentor WG 高速電路板設(shè)計(jì)與仿真

模擬電路前端設(shè)計(jì)培訓(xùn)班

電路設(shè)計(jì)全能班

電子電路設(shè)計(jì)高級培訓(xùn)班

芯片設(shè)計(jì)培訓(xùn)班

集成電路（IC）版圖設(shè)計(jì)培訓(xùn)班

RF射頻電路設(shè)計(jì)培訓(xùn)班

數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班

數(shù)字、模擬電路設(shè)計(jì)培訓(xùn)班

SOC設(shè)計(jì)培訓(xùn)班

嵌入式OS--VxWorks

VxWorks應(yīng)用開發(fā)培訓(xùn)班

VxWorks BSP開發(fā)高級班

PowerPC嵌入式系統(tǒng)/編譯器優(yōu)化

PowerPC(PPC)系統(tǒng)開發(fā)培訓(xùn)班

飛思卡爾MPC系統(tǒng)開發(fā)培訓(xùn)班

編譯器原理及優(yōu)化技術(shù)專題班


PLC編程/變頻器/數(shù)控/人機(jī)界面

PLC編程系列培訓(xùn)課程表
變頻器系列培訓(xùn)課程表

人機(jī)界面、數(shù)控系列培訓(xùn)課程表

開發(fā)語言/數(shù)據(jù)庫/軟硬件測試

Java/.NET/C#/SQL全能培訓(xùn)班

Oracle數(shù)據(jù)庫培訓(xùn)

SQL Server數(shù)據(jù)庫培訓(xùn)

軟件測試培訓(xùn)

硬件測試培訓(xùn)

系統(tǒng)構(gòu)架師培訓(xùn)

Delphi程序設(shè)計(jì)班

VB語言培訓(xùn)班(VB.NET)

QNX實(shí)時(shí)OS編程培訓(xùn)班

3G手機(jī)軟件測試、硬件測試

3G軟件測試工程師班

嵌入式測試和3G手機(jī)硬件測試班

芯片設(shè)計(jì)/大規(guī)模集成電路VLSI

芯片、集成電路設(shè)計(jì)系列一課程表

芯片、集成電路設(shè)計(jì)系列二課程表

云計(jì)算、物聯(lián)網(wǎng)

云計(jì)算、云安全培訓(xùn)班

物聯(lián)網(wǎng)產(chǎn)業(yè)、核心技術(shù)培訓(xùn)班

開源操作系統(tǒng)Tiny OS開發(fā)

小型機(jī)系統(tǒng)管理

IBM AIX 6 Basics培訓(xùn)班

IBM AIX 6 System II培訓(xùn)班

Solaris 操作系統(tǒng)網(wǎng)絡(luò)管理

HP-Unix系統(tǒng)及網(wǎng)絡(luò)管理

IBM 大型機(jī)操作系統(tǒng)培訓(xùn)班

SolidEdge ST&ST2 實(shí)戰(zhàn)

網(wǎng)絡(luò)安全管理實(shí)戰(zhàn)培訓(xùn)

其他類

長期班

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曙海動態(tài)

曙海成功實(shí)施比亞迪DSP2000系統(tǒng)開發(fā)與電機(jī)控制企業(yè)培訓(xùn)
[2011-5-1]

曙海成功實(shí)施Intel（英特爾）Android開發(fā)企業(yè)培訓(xùn)[2011-4-20]

曙海成功實(shí)施奇瑞汽車單片機(jī)開發(fā)企業(yè)培訓(xùn)[2011-4-8]

第89期FPGA應(yīng)用設(shè)計(jì)高級培訓(xùn)班圓滿結(jié)業(yè)
[2011-4-3]

第31期iPhone培訓(xùn)班圓滿結(jié)業(yè)
[2011-3-28]

第67期DSP6000系統(tǒng)開發(fā)培訓(xùn)班圓滿結(jié)業(yè)
[2011-3-25]

第21期MTK培訓(xùn)班完滿結(jié)業(yè)
[2010-4-1]

2009年“寒假培訓(xùn)系列課程”
開始招生[2008-12-31]

曙海嵌入式隆重推出“寒
假培訓(xùn)系列課程”[2007-12-16]

慶祝曙海創(chuàng)立5周年，部分課
程9折回饋學(xué)員[2006-03-12]

　Design of ASIP DSP(Application specific instruction set DSP processors)

入學(xué)要求

學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
◆ 電路系統(tǒng)的基本概念。

班級規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576/13918613812( 微信同號)

為了保證培訓(xùn)效果，增加互動環(huán)節(jié)，我們堅(jiān)持小班授課，每期報(bào)名人數(shù)限3到5人，多余人員安排到下一期進(jìn)行。

上課時(shí)間和地點(diǎn)

上課地點(diǎn)：【上�！浚和瑵�(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學(xué)/六宅臻品【鄭州分部】：鄭州大學(xué)/錦華大廈【石家莊分部】：河北科技大學(xué)/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
近開課時(shí)間(周末班/連續(xù)班/晚班）： ASIP DSP 設(shè)計(jì)培訓(xùn)班：2025年9月15日..實(shí)用實(shí)戰(zhàn)....實(shí)戰(zhàn)培訓(xùn)....用心服務(wù)..........--即將開課--............................

實(shí)驗(yàn)設(shè)備

　    ☆資深工程師授課

        ◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學(xué)員免費(fèi)推薦工作



        專注高端培訓(xùn)17年，曙海提供的課程得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力
        得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

        ★實(shí)驗(yàn)設(shè)備請點(diǎn)擊這兒查看★

曙海新優(yōu) 惠

◆在讀學(xué)生憑學(xué)生證，可優(yōu)惠500元。

.質(zhì).量.保.障.

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費(fèi)提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會。。專注高端培訓(xùn)17年，曙海提供的課程得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

　　　　　　　　Design of ASIP DSP（ASIP DSP 設(shè)計(jì)）

General CPU is converging and DSP has been diverging. We need more kinds of DSP processors for domain specific applications because we need high performance, low power, and low silicon costs the same time. If the volume is high, the design and prototyping costs are negligible.
To design ASIP DSP needs a special design methodology to get the right function coverage and right hardware and software partition. We can also get the chip to market in time if the methodology is correct. In this course, the design of ASIP DSP will be introduced from concept up to design decision and finally down to the micro architecture design.

1．引論
2． ASIP設(shè)計(jì)方法
3．有限長數(shù)字信號處理
4． DSP處理器結(jié)構(gòu)與微結(jié)構(gòu)
5．指令集設(shè)計(jì)
6．編程工具設(shè)計(jì)
7．處理器數(shù)據(jù)通道
8．存儲器子系統(tǒng)
9．處理器控制通道
10．嵌入系統(tǒng)軟件設(shè)計(jì)
11． DSP匯編語言設(shè)計(jì)
12．實(shí)例：浮點(diǎn)Audio DSP 設(shè)計(jì)

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